Synopsys日前宣布，在其Galaxy设计实现平台中推出了最新的RTL综合工具Design Compiler 2010，它将综合和物理层实现流程增速了两倍。Design Compiler自1988年问世以来，随着工艺技术从1.5微米到32纳米的进步，而不断得到调整升级。而今时序与面积布线的优化已成为主要的挑战，最新版工具与时俱进，针对拓扑技术进行扩展，为Synopsys布局布线解决方案IC Compiler提供“物理层指引”;将时序和面积的一致性提升至5%的同时，还将IC
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Synopsys RTL 32纳米
全球领先的半导体设计、验证和制造的软件及知识产权(IP)供应商新思科技有限公司日前宣布：该公司在其Galaxy™设计实现平台中推出了最新的创新RTL综合工具Design Compiler 2010，它将综合和物理层实现流程增速了两倍。为了满足日益复杂的设计中极具挑战性的进度要求，工程师们需要一种RTL综合解决方案，使他们尽量减少重复工作并加速物理实现进程。为了应对这些挑战，Design Compiler 2010对拓扑技术进行扩展，为Synopsys旗舰布局布线解决方案IC Compile
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Synopsys Galaxy RTL
假如IC设计的速度能够加快数倍，那么拥有各种复杂功能的各类电子产品将再次改变我们的生活。
IC设计中设计与验证的流程通常需要数月甚至数年，其中的人工重新编码的过程费时且容易出错，Synopsys选择这一环节为突破，开发出了Synphony高层次综合EDA工具，通过其独特的MATLAB语言、基于模型的解决方案，针对ASIC和FPGA芯片设计实现了10倍的设计与验证能力。
据Synopsys公司总监Chris Eddington介绍，Synphony的创意来自被收购的Synplicity公司，
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Synopsys IC设计 EDA
全球领先的半导体设计、验证和制造软件、硬件及知识产权(IP)供应商新思科技公司(NASDAQ: SNPS)，今天宣布推出其Synphony HLS (High Level Synthesis)解决方案。该解决方案集成了M语言和基于模型的综合法，与 传统RTL流程相比，能够为通信和多媒体应用提供高达10倍速的更高的设计和验证能力。Synphony HLS为ASIC 和 FPGA的应用、架构和快速原型生成最优化的RTL。此外，通过在虚拟平台中为系统验证和早期软件开发生成C模型，Synphony HLS补充
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Synopsys Synphony HLS
简·奥斯汀的《理智与情感》告诉我们，若要在地位和金钱都凌驾于爱情之上的社会得到幸福，一定要懂得在理智与情感之间取得平衡。对于在竞争激烈的科技领域驾御企业走向成功，同样不可缺少智慧和激情的平衡。近日，记者在北京采访了Synopsys公司董事长兼首席执行官Aart De Geus先生，这位一直强调以智慧和激情引领企业成功的商业奇才谈起了应对金融危机下的企业发展策略。
让De Geus先生可以坐在记者面前谈笑风生最重要的支撑就是Synopsys公司是在EDA行业中少数几个业绩预期继续增长
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Synopsys EDA IP 200907
全球领先的半导体设计与制造的软件和知识产权（IP）供应商新思科技（Nasdaq：SNPS）今天发布了VCS®功能验证解决方案...
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Synopsys VCS 新思科技 验证
全球领先半导体设计和制造软件及IP供应商Synopsys公司，今天宣布推出其扩展型Confirma™快速原型平台。通过引入最近收购的CHIPit®各种产品、工具和技术，简化了快速原型构建的实施和部署工作，确保用户可以更快地开始硬件辅助系统验证和嵌入式软件开发。再辅之以HAPS高性能原型硬件，扩展型Confirma平台现可同时提供软件可配置架构和基于事务的协同验证能力。Confirma平台结合了经过验证的原型方法、IP、服务、硬件和软件，对于多种原型应用来说都是一个全面的解决方案。S
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Synopsys Confirma
美国加利福尼亚州MOUNTAIN VIEW ，2009年2月9日—全球领先半导体设计和制造软件及IP供应商Synopsys公司（纳斯达克股票代码：SNPS），今天宣布推出其扩展型Confirma™快速原型平台。通过引入最近收购的CHIPit®各种产品、工具和技术，简化了快速原型构建的实施和部署工作，确保用户可以更快地开始硬件辅助系统验证和嵌入式软件开发。再辅之以HAPS高性能原型硬件，扩展型Confirma平台现可同时提供软件可配置架构和基于事务的协同验证能力。Conf
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Synopsys Confirma
Altera和Synopsys宣布，Altera流行的Nios II处理器内核可通过DesignWare Star IP包提供许可给客户使用。这一新品扩展了Altera现有的FPGA和HardCopy®结构化ASIC产品供给，帮助Nios II用户将设计移植到标准单元ASIC。Nios II处理器内核是应用最广泛的FPGA处理器，其客户群有5,000多家电子设备生产商，包括世界上排名靠前的OEM。
通过DesignWare Star IP包，设计人员可以使用一流Star IP供应商开发的
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嵌入式系统 单片机 Altera Synopsys Nios II MCU和嵌入式微处理器
Synopsys公司宣布基于中芯国际130纳米G工艺的DesignWare? USB 2.0 nanoPHY IP已获USB标志认证，PCI Express (PCIe) PHY IP已通过一致性测试。作为用于PCI Express和 USB 2.0 的完整IP解决方案的领先技术供应商，Synopsys一贯为设计者提供高质量IP，该IP不但集成风险低、上市时间短，而且具有很高
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消费电子 Synopsys 中芯国际 USB 消费电子
近年来，高校与企业间的合作越来越多。与《电子产品世界》曾经合作过大学计划的就有TI，NI，Altera，Freescale，Xilinx，ST，Microchip，ARM，英蓓特等很多企业。大学通过与企业合作，与市场联系得更紧密，知道市场更需要什么样的人才，从企业引入了资金和项目；学生通过参加企业组织的大学计划，得到了实践和锻炼机会，从而有更多机会在毕业后进入世界一流的企业工作；企业通过组织大学计划，加强了与高校的沟通和联系，使企业形象和技术理念深入人心，从中获得了优
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高校 企业 合作 Synopsys ST 大学计划
Synopsys今天宣布，由ARM 和 Synopsys 公司推出的SystemVerilog 验证方法学（VMM）被中国主要电子公司采用，用于开发先进验证环境。Synopsys 还宣布，《SystemVerilog 验证方法学》一书中文版已由中国航空航天大学出版发行。至今，本书的英文版已售出3,500多本。
《SystemVerilog 验证方法学》由 ARM 和 Synopsys 公司的技术专家共同撰写，书中描绘了如何使用 SystemVerilog 创建采用覆盖主导、随机约束、基于断言验证
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Synopsys VMM 单片机 嵌入式系统
Synopsys发布了最新版 DESIGN Compiler 综合解决方案—— Design Compiler 2007。新版本扩展了拓扑技术，以加速采用先进低功耗和测试技术的设计收敛，帮助设计人员提高生产效率和 IC 性能。 拓扑技术可帮助设计人员正确评估芯片在综合过程中的功耗，在设计早期解决所有功耗问题。此外，还支持 Design Compiler 2007 中新的测试压缩技术，在实
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Synopsys 消费电子 消费电子
Synopsys发布了下一代布局布线解决方案——IC Complier 2007.03版。该版本运行时间更快、容量更大、多角/多模优化（MCMM）更加智能、而且具有改进的可预测性，可显著提高设计人员的生产效率。 同时，新版本还推出了支持正在兴起的45纳米技术的物理设计。目前，有近百个采用IC Compiler的客户设计正在进行中，订单金额超过一亿美元。IC Compiler正成为越来越多市场领先的IC设计公司在各种应用和广泛硅技术中的理想选择。2007.03&nbs
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Synopsys 布局布线 下一代
Synopsys 今天发布了下一代布局布线解决方案——IC Complier 2007.03 版。该版本运行时间更快、容量更大、多角/多模优化（MCMM）更加智能、而且具有改进的可预测性，可显著提高设计人员的生产效率。
同时，新版本还推出了支持正在兴起的45纳米技术的物理设计。目前，有近百个采用IC Compiler的客户设计正在进行中，订单金额超过一亿美元。IC Compiler正成为越来越多市场领先的IC设计公司在各种应用和广泛硅技术中的理想选择。2007.03 版的重大技术创新将为加速其广
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COMPILER Synopsys 单片机 嵌入式系统
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